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逻辑仿真

模拟器是一种软件过程用于执行硬件的典范
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描述

逻辑模拟器主要工作寄存器传输级(RTL)模型的数字部分硬件系统编写的Verilog或硬件描述语言(VHDL)的语言。大多数模拟器能够接受模型在若干个不同的抽象层次上包括门,RTL和行为,但仅限于提供的语义支持的语言。商业模拟器经常接受多种语言在一个模拟的意义,各种语言的语义可以组合虽然限制被放置到语言之间的界限可以驻留的地方。

最普遍的技术用于构建一个逻辑模拟器被称为事件驱动。事件中创建模拟器时信号变化值。这些事件将发生在未来的某个时间点,基于电路的时机。模拟器可以确保在正确的时间事件处理。多个事件可以发生在同一时间,这是用来模拟并发中找到硬件系统。仿真时间先进所有事件目前已经执行。

这种技术叫做编译代码的扩展模拟。传统的基于事件的模拟器解释模型创建必要的事件。编译后的代码模拟器将部分RTL模型,并将其转换为C代码。然后编译和执行直接输入RTL代码段时改变。评估的RTL块不使用调度或其他时间在模拟器的核心功能。

另一个使用仿真技术在过去被称为循环模拟。这假设没有时机问题在设计和创建的所有事件中电路将在下一个时钟的边缘之前解决。模拟器因此没有处理时机,但缺点是,所有的设计评估每一辆自行车,因为它没有跟踪哪些逻辑变化对每个周期。今天几个商业模拟器使用这种技术的存在虽然这是大多数逻辑模拟器的基础。模拟器模拟执行类似的任务但使用专用硬件而不是一个通用的计算机。

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