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短暂的历史逻辑仿真

历史上重要事件的逻辑模拟
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在1970年代,大多数模拟门口水平和主要用于板级仿真。商业模拟器包括Lasar Teradyn和Tegas。1981年,帕克是由英国布鲁内尔大学和商业化的卷云电脑。它是第一个真正的RTL模拟器虽然没有创造了这个词。小矿脉2的组合逻辑模拟器故障模拟器,min-max时机模拟器。早期波形模拟器逻辑语言看起来非常像测试语言,因此大多数模拟器在这个时候结束了被测试者收购公司。例如,卷云电脑在1983年被GenRad收购。

菲尔Moorby小矿脉2的创造者之一,离开GenRad,开始为网关设计自动化工作。1984年,他创建了Verilog硬件描述语言(HDL)。这是第一个模拟器支持芯片仿真所需的一些能力。1990年网关被节奏设计系统。

1981年美国国防部(DoD)计划提出了被称为VHSIC(非常高速集成电路)计划。1986年开发的高密度脂蛋白在这个程序中得到了IEEE的标准化。它被称为硬件描述语言(VHDL) (Vhsic HDL)。IEEE标准1076 - 1987。

作为回应,节奏开始打开Verilog语言和1990年创建开放的Verilog国际(OVI)。

这两种语言打了一场艰苦的战役,据说EDA历史上最昂贵的错误。Verilog当今最流行的语言虽然硬件描述语言(VHDL)是仍在使用。

最受欢迎的验证方法使用直到这个时间称为直接验证。每个测试是针对运动设计的某些方面。在太阳微系统公司开发的一种新技术被使用随机化的刺激。用来做这个的语言被称为维拉和商业化的系统科学。系统科学在1998年被Synopsys对此收购。这周围的方法被称为约束随机测试模式生成。

在90年代后期合作设计自动化开始着手一组扩展Verilog,他们称为SuperLog。2002年合作设计了Synopsys对此和部分SuperLog被用于创建SystemVerilog。此外,开进SystemVerilog维拉的许多方面。


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