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艰难的IP

完整设计的硬件IP块
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描述

硬IP可以被视为制造可以集成到更大设备的芯片所需的掩码集。通常,模拟块或诸如SERDES之类的设备作为硬IP交付。当这种类型的IP被交付时,它很可能是一组GDSII文件。

除了布局,IP开发人员还需要为IP提供一个定时模型,可能是一个SPICE模型,以便执行详细的仿真,用于信号完整性仿真的IBIS模型,用于可测试性的模型等。此外,将设备集成到SoC中还需要一个功能性的Verilog或VHDL模型。


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