清洁硬件描述语言(VHDL)和SystemVerilog Sigasi:

公司软件技术适用于硬件编码。

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硬件工程师总是看着软件工具和方法有一定程度的嫉妒。在硬件方面已经接受了必要的纪律,从而获得产品发布前,在很大程度上,因为它太贵了修复一个错误在硬件,工具和语言通常更和方法更严格。像软件一样,他们必须包括复杂的依赖关系,但与软件也必须与铸造厂提供的一组设计规则,以确保他们可以生产足够的收益。

有很多多年来谈论需要新方法,如应用敏捷技术,以及硬件简化硬件开发的新语言。但到目前为止,这些改进是有限的。很难把这些想法融入易于理解的设计流,很难得到整个行业尝试新的做事方式。

比利时硬件软件输入Sigasi合作设计公司,利用一些软件来提高硬件代码中使用的概念。

“我们所做的就是重新定义设计由软件偷的想法,”菲利普西班牙说,公司的首席执行官和创始人之一。“我们是软件工程师,而不是数字硬件工程师。”

方法是解析硬件描述语言(VHDL)和Verilog,运行它通过一个数据库,并提供反馈信息数据不匹配。

“与现有的解析器,代码需要完成解析它之前,“西班牙说。“我们的解析器在实际工作时间,所以如果你中途一个句子你可以跳过它。这就是微软Visual Studio。时更新状态机类型。你可以找到语法错误,你可以画出方框图和得到反馈。我们也与产品毛羽Aldec工具集成和OneSpin解决方案。

Eclipse Sigasi背后的工具,和Visual Studio都属于软件的集成开发环境。这些通常包括源代码编辑器、调试器和工具自动化软件构建。西班牙说这些方法没有可用的硬件工程师,但足够多的人知道Eclipse的学习曲线很低。这对code-re-use变得特别重要,他指出,因为代码可以检查之前重新编译来确定什么坏了。

的一个地区公司已经成功在文档。莫德斯托卡萨斯,Sigasi的北美销售和业务发展,说这是医疗设备等关键市场和传统设计中使用新的市场。“如果一个医疗植入休息,它可以杀死一个人,”他说。“在国防工业,可以更广泛的损害。这适用于任何安全性至关重要的。”



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