如何应对变化的标准和算法和仍然满足时机。
Achronix的Speedcore eFPGA IP允许公司嵌入一个可编程序逻辑结构在ASIC交付最终用户能够修改或升级后功能ASIC的部署。这种灵活性大大扩展解决方案空间可以由ASIC服务,因为它可以更新支持改变标准和算法。关闭时间是特别具有挑战性因为eFPGA织物可能主机任意数量的设计在设备操作。这些设计必须与其他ASIC,独立工作和时间关闭只能说已经遇到了如果所有可能的设计针对eFPGA织物能满足时机。
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