系统与设计
白皮书

TLM-Driven设计和Verification-Time方法论的转变

RTL流竭力满足大多数产品团队的要求。向上移动一个抽象层次不再是一种选择。

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而今天的RTL设计和验证流加强门电路级流动的二十年前,RTL流竭力满足大多数产品团队的要求。当设计采购和验证在寄存器传输级(RTL), IP重用是困难的,功能验证是漫长而繁琐,架构决策不能RTL验证前确认。越来越大的压力在今天的SoC和ASIC设计团队提供更积极的设计用更少的时间,和需要设计第一遍,许多公司正寻求进入下一个抽象层次之外的RTL急需的提高设计效率。

下一个抽象层次是基于事务级建模(TLM)。通过创建TLM IP作为他们的黄金来源,设计团队可以缓解IP创建和重用,引入更少的错误,花更少的时间和精力在功能验证,并迅速探索范围广泛的微架构的实现选择。设计迭代减少因为TLM验证RTL验证要快得多,可以验证和架构的选择之前RTL验证。此外,更高抽象事务级模型可以用于硬件/软件co-verification,并且可以早期虚拟平台软件开发的一部分。所有这些优势的最终结果将是更高的设计效率。



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