一篇题为“CVA6 RISC-V虚拟化:架构、微架构和设计空间探索”的新技术论文由葡萄牙米尼奥大学、博洛尼亚大学和苏黎世联邦理工学院的研究人员撰写。
摘要摘录:“在本文中，我们描述了我们在RISC-V CVA6核心中硬件虚拟化支持方面的工作。我们的贡献是多方面的，包括建筑、微建筑和设计空间探索。我们特别强调了一组微架构增强的设计(即G-Stage Translation Lookaside Buffer (GTLB)， L2 TLB)，以减轻虚拟化性能开销。我们还进行了设计空间探索(DSE)和伴随的布局后模拟(基于22nm FDX技术)，以评估性能、功率和面积(PPA)。此外，我们将设计变体映射到FPGA平台(Genesys 2)上，以评估功能性能区域的权衡。”
找到技术纸在这里(预印本)。2023年2月。
Sá， Bruno等，“CVA6 RISC-V虚拟化:架构、微架构和设计空间探索。“arXiv预印arXiv:2302.02969(2023)。
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