新的RISC-V核心和工具;fpga NVMe存储;低功率FPGA;SoC FPGA。
Rambus完成它收购硅的IP安全协议和供应业务Verimatrix,以前在安全,以4500万美元的价格在关闭,和额外的2000万美元,在2020年确定的收入目标。
RISC-V
SiFive公布了两个新产品的家庭。SiFive顶点处理器核心目标关键任务处理器与大小、重量和功耗(SWaP)使用开源神灵方法优化和生成。SiFive智能处理器核心目标深度学习与向量处理市场。它使用RISC-V向量扩展(RVV)和显示平均性能提升9 x vs RISC-V传统标量处理。
西部数据公司扩大其开源RISC-V-based SweRV核心家庭包括dual-threaded、商业、嵌入式RISC-V核心,核心EH2 SweRV,和公司的最小SweRV核心迄今为止,EL2。此外,该公司宣布OmniXtend硬件参考设计,开放“直接在以太网缓存”织物协议。
Codasip宣布一个新的SweRV支持包(SSP)提供所有必需的组件设计,实现,测试,和编写软件SweRV核心EH1-based芯片系统,包括但不限于验证testbenches和知识产权,参考脚本主要EDA流,模型模拟和仿真和软件开发工具。
UltraSoC将提供的一个开源实现RISC-V跟踪编码器通过OpenHW组。开源RISC-V跟踪解决方案是完全兼容的处理器跟踪标准目前正在开发中的RISC-V基金会的处理器跟踪工作小组。UltraSoC最初开发的RISC-V跟踪编码算法在2016年,规范捐赠开源不久。
FPGA
Aldec推出了一个新的fpga NVMe数据存储解决方案帮助高性能计算(HPC)应用程序的开发等高频交易和机器学习。解决方案包含一个Aldec TySOM嵌入式原型板和八个高带宽,低延迟FMC-NVMe女儿卡,和一个参考设计(包括源文件和二进制文件)。FMC-NVMe卡提供了四个非易失性内存表达(NVMe)接口。这些都是连接到一个Microsemi PM8532作为PCIe开关,它提供了一种通过作为PCIe connection-to-carrier-card出数GEN3接口使用标准融合连接器。FMC-NVMe女儿卡支持董事会堆积。
晶格宣布关系,一个新的低功耗FPGA平台。架构优化性能的低功耗优化包括DSP模块和更高的片上内存容量。这是在大容量FD-SOI 28 nm制程工艺开发三星和目标等一系列应用人工智能物联网、视频、硬件安全、嵌入式视觉,5 g的基础设施和工业/汽车自动化。
微芯片打开早期访问计划新PolarFire SoC FPGA,这提供了一个硬实时Linux能够RISC-V-based微处理器子系统在中档PolarFire FPGA的家庭。它包括调试功能,包括指令跟踪和被动运行时配置从UltraSoC AXI总线监视器,50个断点,FPGA织物显示器,内置双通道逻辑分析仪SmartDebug。PolarFire SoC架构包括可靠性和安全特性,比如单纠错和双错误检测(SEC-DED)在所有记忆,物理内存保护,抗DPA加密的核心,defense-grade安全引导和128 Kb的flash引导记忆。
交易
对话框半导体许可Flex Logix的EFLX eFPGA用于大容量ICs,以及EFLX依从者。“eFPGA功能添加到我们的产品给我们的客户的灵活性跟上快速变化的市场需求,“Davin Lee说的对话框。
全球Unichip公司(GUC)选择ANSYS的签收RedHawk-SC全芯片SoC权力的完整性和可靠性。GUC引用减少复杂性的能力,加快上市时间,降低开发成本。
GUC也部署抑扬顿挫的advanced-node数字实现和结果流(但,不行了N12和N7)设计的人工智能和高性能计算(HPC)应用程序,实现初步的硅成功和满足一个GHz其数十亿门设计的性能目标。
燃烧技术将使用Rambus的HBM2 PHY和内存控制器IP为其新一代人工智能训练的筹码。燃烧引用2 tb的可用性/ s的带宽和高内存子系统的性能。
Calterah半导体包括Synopsys对此的DesignWare弧EM6处理器IP的新一代先进CMOS毫米波雷达SoC(毫米波)。Calterah阿尔卑斯山的新芯片系列包括四个发射机渠道最多四个接收机频道,一个高度可配置的波形发生器,和一个集成的模拟-数字转换器采样率50议员。它还弧MetaWare开发工具包用于安全满足ASIL B的要求。
联发科选择导师的ReadyStart版的核心操作系统平台的发展下一代调制解调器芯片,从2 g到4 g,以及其5 g芯片组。联发科引用源代码可用,占用空间小,实时性能和技术支持。
事件
查看即将到来183新利
:明年,DesignCon将1月28 - 30在圣克拉拉,CA,专注于董事会和高速通信的设计。
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