随着设计规模和复杂性的增加,IP(知识产权)作为更好的SoC设计的基本构建块的使用也在增加。本文介绍了SoC级IP集成过程中面临的挑战,以及在IP开发过程中可以采取哪些措施来减轻这些风险。Mentor的Oasys-RTL RTL平面规划和物理合成工具提供了一个独特的IP认证平台,帮助设计师创建高质量和物理可实现的RTL。
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